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2024.02.25 13:57
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[VerilogHDL] Project : FPGA Multi Function Clock PPT & PDF
Project2024.06.13 22:58[VerilogHDL] Project : FPGA Multi Function Clock PPT & PDF

Project : FPGA Multi Function Clock ⦁  개요 : Digilent Basys3를 이용한 FPGA Multi Function Clock 설계 및 검증 ⦁  기능     1. Clock ↔ Stopwatch 모드 변경           1) 스위치 조작           2) UART 조작 : "Clock" 혹은 "Stopwatch" 입력     2. Clock 모드 : FND 시간 표시           1) 스위치 & 버튼 조작                 a) 스위치 : [시 : 분] 혹은 [초 : 밀리초] FND 출력 모드 선택                 b) 버튼 : 시간을 설정 & 0으로 설정           2) UART 조작                 a) "..

[VerilogHDL] AXI-Lite 구현
Study2024.06.18 09:14[VerilogHDL] AXI-Lite 구현

1.  APB(Advanced Peripheral Bus)저전력, 저가, 간소화된 버스속도가 느린 peripheral을 연결하는데에 사용(TIM, UART 등)위와 같이 비교적 복잡하지 않은 구조를 가지고 있다.(Master 1개, Slave 여러개)7개 Input, 1개 OutputSelect 신호를 통해 Slave를 특정하고 해당 Slave 메모리 안의 데이터를 Address를 이용해 접근한다. APB의 FSM은 위와 같은데ACCESS state에서PREADY == 1이고 더이상 전송이 없으면 IDLE state로 가고PREADY == 0일때는 계속 IDLE state를 유지한다  2.  AHB(Advanced High-performance Bus)APB와는 다르게 Arbiter가 존재한다.Sel 신..

[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type
Study2024.06.18 01:22[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type

1.  RISC-VRV32I(Base Integer Instruction Set)를 구현해보자.→ 곱셈, 나눗셈 연산이 없는 정수형 명령어 세트  Instruction 구조(1) : RV32I의 Register File : 32개의 레지스터(2) : 명령어 구조는 32bit 고정(RISC의 특징), R ~ J-Type 구조가 있다. 각 명령어 레지스터에 대한 프로그래밍 권장사항(의미부여) → 굳이 안따라가도 되지만 이런식으로 가이드가 정해져있다.   2.  CPU 기본 모듈ALURegister FilePC(Program Counter) RegisterInstruction이 실행할 위치(Instruction Memory)를 가지고 있는 RegisterInstruction MemoryData Memory  ..

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[VerilogHDL] AXI-Lite 구현
Study
2024.06.18 09:14
[VerilogHDL] AXI-Lite 구현
1.  APB(Advanced Peripheral Bus)저전력, 저가, 간소화된 버스속도가 느린 peripheral을 연결하는데에 사용(TIM, UART 등)위와 같이 비교적 복잡하지 않은 구조를 가지고 있다.(Master 1개, Slave 여러개)7개 Input, 1개 OutputSelect 신호를 통해 Slave를 특정하고 해당 Slave 메모리 안의 데이터를 Address를 이용해 접근한다. APB의 FSM은 위와 같은데ACCESS state에서PREADY == 1이고 더이상 전송이 없으면 IDLE state로 가고PREADY == 0일때는 계속 IDLE state를 유지한다  2.  AHB(Advanced High-performance Bus)APB와는 다르게 Arbiter가 존재한다.Sel 신..
[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type
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2024.06.18 01:22
[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type
1.  RISC-VRV32I(Base Integer Instruction Set)를 구현해보자.→ 곱셈, 나눗셈 연산이 없는 정수형 명령어 세트  Instruction 구조(1) : RV32I의 Register File : 32개의 레지스터(2) : 명령어 구조는 32bit 고정(RISC의 특징), R ~ J-Type 구조가 있다. 각 명령어 레지스터에 대한 프로그래밍 권장사항(의미부여) → 굳이 안따라가도 되지만 이런식으로 가이드가 정해져있다.   2.  CPU 기본 모듈ALURegister FilePC(Program Counter) RegisterInstruction이 실행할 위치(Instruction Memory)를 가지고 있는 RegisterInstruction MemoryData Memory  ..
[FullCustomIC] Project : One Chip Design + 4bit Universal Shift Register PPT & PDF
Project
2024.06.17 20:40
[FullCustomIC] Project : One Chip Design + 4bit Universal Shift Register PPT & PDF
Project : One Chip Design + 4bit Universal Shift Register ⦁  개요 : 디지털 회로(Subtractor, MUX, Logic Gates, ...)와 아날로그 회로(CS AMP, Differential AMP)를 하나의 Chip으로 설계 + 4bit Universal Shift Register IP 설계 ⦁  구성     1. 4bit Universal Shift Regiser           1) Right Shift, Left Shift, Parallel Load                 a) TGFF로 설계     2. Subtractor, 4bit Adder     3. 16x1 MUX, 8x1 MUX, 4x1 MUX, 2x1 MUX     4. ..
[VerilogHDL] Project : Design RISC-V CPU with AHB-Lite & Peripherals PPT & PDF
Project
2024.06.14 01:41
[VerilogHDL] Project : Design RISC-V CPU with AHB-Lite & Peripherals PPT & PDF
Project : Design RISC-V CPU with AHB-Lite & Peripherals ⦁  개요 : RISC-V RV32I Architecture CPU & AMBA AHB-Lite & Peripherals 설계 및 검증 ⦁  기능     1. RISC-V RV32I Architecture CPU Core           1) Control Unit, Data Path           2) Single Cycle, Multi Cycle     2. AMBA Simple Bus(AHB Lite)           1) BUS Interconnector     3. Peripherals           1) RAM & ROM           2) GPI           3) GPIO ..
[VerilogHDL] Project : FPGA Multi Function Clock PPT & PDF
Project
2024.06.13 22:58
[VerilogHDL] Project : FPGA Multi Function Clock PPT & PDF
Project : FPGA Multi Function Clock ⦁  개요 : Digilent Basys3를 이용한 FPGA Multi Function Clock 설계 및 검증 ⦁  기능     1. Clock ↔ Stopwatch 모드 변경           1) 스위치 조작           2) UART 조작 : "Clock" 혹은 "Stopwatch" 입력     2. Clock 모드 : FND 시간 표시           1) 스위치 & 버튼 조작                 a) 스위치 : [시 : 분] 혹은 [초 : 밀리초] FND 출력 모드 선택                 b) 버튼 : 시간을 설정 & 0으로 설정           2) UART 조작                 a) "..
[VerilogHDL] CPU 기본 구조, 메모리, Counter 설계(Control Unit, Data Path)
Study
2024.06.03 09:31
[VerilogHDL] CPU 기본 구조, 메모리, Counter 설계(Control Unit, Data Path)
#1.  CPUCPU 아키텍처에는 크게 CISC와 RISC가 있다. #1-1.  CISC(Complex Instruction Set Computer)복잡한 명령어CISC 프로세서에는 매우 복잡하고 단일 명령어로 여러 개의 Low-Level 작업(예: 산술과 결합된 메모리 액세스)을 수행할 수 있는 대규모 명령어 세트가 있다.가변 명령어 길이CISC 아키텍처의 명령어는 길이가 다양할 수 있으므로 더 복잡한 작업이 더 적은 명령어로 인코딩되므로 프로그램 크기가 더 작아질 수 있다.레지스터 적음각 명령어의 복잡성과 기능으로 인해 CISC는 더 적은 수의 레지스터를 가지며 메모리 작업에 더 많이 의존한다.Microcode복잡한 명령어를 프로세서에서 내부적으로 처리하는 간단한 단계로 분해한다.[장점]High-Le..
[Octave] FER2013 Dataset-Facial expression prediction model(Supervised Learning)
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2024.06.03 01:05
[Octave] FER2013 Dataset-Facial expression prediction model(Supervised Learning)
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