Minba's blog

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2024.02.25 13:57

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Study2024.04.20 22:24[FullCustomIC] Cadence Virtuoso_4x1 MUX(Logic, Switch), 8x1 MUX(Logic, Switch), 16x1 MUX(Logic, Switch)

1. 4x1 MUX(Logic) ⦁ Truth Table VINA VINB VINC VIND S0 S1 VOUT A B C D 0 0 A A B C D 1 0 B A B C D 0 1 C A B C D 1 1 D 2. 4x1 MUX(Switch) 3. 8x1 MUX(Logic) ⦁ Truth Table S2 S1 S0 VOUT 0 0 0 VINA 0 0 1 VINB 0 1 0 VINC 0 1 1 VIND 1 0 0 VINE 1 0 1 VINF 1 1 0 VING 1 1 1 VINH 4. 8x1 MUX(Switch) 5. 16x1 MUX(Logic) ⦁ Truth Table S3 S2 S1 S0 VOUT 0 0 0 0 VINA 0 0 0 1 VINB 0 0 1 0 VINC 0 0 1 1 VIND 0 1 0..

이론2024.03.09 00:58[FullCustomIC] MOSFET 기본 이론(2)_Stick Diagram 등

■ pMOS, nMOS 직∙병렬 동작 ⦁ MOSFET 동작 Input nMOS pMOS 0 OFF ON 1 ON OFF ⦁ 직⋅병렬 MOSFET 동작(2개) Input_1 Input_2 직렬 병렬 nMOS pMOS nMOS pMOS 0 0 OFF ON OFF ON 0 1 OFF OFF ON ON 1 0 OFF OFF ON ON 1 1 ON OFF ON OFF 두개 모두 ON이어야 연결 둘 중 하나만 ON이면 연결 ■ Gate Layout Stick Diagram : Layout을 빠르게 만들 수 있다. [Stick Diagram 그리는 법] 1. CMOS Schematic을 그린다. 2. pMOS부 혹은 nMOS부 중 하나를 선택하고 각 FET을 모두 한번씩만 경유하는 길(path)을 찾는다. → 이때 ..

Study2024.05.19 23:59[VerilogHDL] FSM 코딩(Moore, Mealy) - 버튼, UpCounter

1. FSM(Finite State Machine) (1) Moore 머신 : 출력이 현재 상태에 의해서만 결정Present State Next State Output input 0input 1 S0S1S00S1S1S01(2) Mealy 머신 : 출력이 현재 상태와 입력에 의해서 결정 Present State Next State Output input 0input 1input 0input 1S0S1S010S1S1S010 Next-State LogicNext State를 계산, 결정하는 회로현재 상태 및 입력에 따라 다음 상태를 결정State Registerclk edge에서 현재 State update(저장) ← state = next_state 형식으로..Output Logic현재 S..

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2024.07.10 03:10

[전자회로] Project : Distance Measurement Circuit using Supersonic Sensor PPT & PDF

Project : Distance Measurement Circuit using Supersonic Sensor ⦁ 개요 : 차량 후방 감지 및 로봇 청소기 등에 사용하는 거리 측정 회로를 초음파 센서를 이용하여 설계 및 제작 ⦁ 기능 1. 거리 측정 범위최소 거리: 30cm최대 거리: 1m측정 단위: [cm]실시간 거리 측정 2. 회로 구성 요소송신 신호 주파수: 40kHz수신 신호 카운팅 주파수: 17.2kHz3개의 FND(Seven-Segment Display)를 사용하여 거리 표시 3. 설계 및 측정 회로초음파 발진 회로Tx 타이밍 펄스 발진 회로초음파 송신 회로초음파 수신 회로신호 정류 회로신호 검출 회로시간 측정 회로카운팅 펄스 발진 회로카운터/래치 클리어 펄스 회로 ⦁ 개발 기간..

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2024.07.07 23:34

[VerilogHDL] Project : Intelligent Vehicle Control System PPT & PDF

Project : Intelligent Vehicle Control System ⦁ 개요 : Microblaze Soft Process Core CPU(RISC Architecture)를 이용하여 AXI4-Lite Protocol기반 각종 Peripherals 설계 및 UVM 검증을 통한 Intelligent Vehicle Control System 개발 ⦁ 기능 1. Microblaze Soft Process Core CPU & AXI4-Lite Protocol 2. Peripherals 설계 및 UVM 검증 1) UART 2) GPIO 3) FND Controller 4) UART 5) PWM ..

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2024.06.18 09:14

[VerilogHDL] AXI-Lite 구현

1. APB(Advanced Peripheral Bus)저전력, 저가, 간소화된 버스속도가 느린 peripheral을 연결하는데에 사용(TIM, UART 등)위와 같이 비교적 복잡하지 않은 구조를 가지고 있다.(Master 1개, Slave 여러개)7개 Input, 1개 OutputSelect 신호를 통해 Slave를 특정하고 해당 Slave 메모리 안의 데이터를 Address를 이용해 접근한다. APB의 FSM은 위와 같은데ACCESS state에서PREADY == 1이고 더이상 전송이 없으면 IDLE state로 가고PREADY == 0일때는 계속 IDLE state를 유지한다 2. AHB(Advanced High-performance Bus)APB와는 다르게 Arbiter가 존재한다.Sel 신..

[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type

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2024.06.18 01:22

[VerilogHDL] RISC-V 기본, RV32I R-Type, IL-Type

1. RISC-VRV32I(Base Integer Instruction Set)를 구현해보자.→ 곱셈, 나눗셈 연산이 없는 정수형 명령어 세트 Instruction 구조(1) : RV32I의 Register File : 32개의 레지스터(2) : 명령어 구조는 32bit 고정(RISC의 특징), R ~ J-Type 구조가 있다. 각 명령어 레지스터에 대한 프로그래밍 권장사항(의미부여) → 굳이 안따라가도 되지만 이런식으로 가이드가 정해져있다. 2. CPU 기본 모듈ALURegister FilePC(Program Counter) RegisterInstruction이 실행할 위치(Instruction Memory)를 가지고 있는 RegisterInstruction MemoryData Memory ..

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2024.06.17 20:40

[FullCustomIC] Project : One Chip Design + 4bit Universal Shift Register PPT & PDF

Project : One Chip Design + 4bit Universal Shift Register ⦁ 개요 : 디지털 회로(Subtractor, MUX, Logic Gates, ...)와 아날로그 회로(CS AMP, Differential AMP)를 하나의 Chip으로 설계 + 4bit Universal Shift Register IP 설계 ⦁ 구성 1. 4bit Universal Shift Regiser 1) Right Shift, Left Shift, Parallel Load a) TGFF로 설계 2. Subtractor, 4bit Adder 3. 16x1 MUX, 8x1 MUX, 4x1 MUX, 2x1 MUX 4. ..

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2024.06.14 01:41

[VerilogHDL] Project : Design RISC-V CPU with AHB-Lite & Peripherals PPT & PDF

Project : Design RISC-V CPU with AHB-Lite & Peripherals ⦁ 개요 : RISC-V RV32I Architecture CPU & AMBA AHB-Lite & Peripherals 설계 및 검증 ⦁ 기능 1. RISC-V RV32I Architecture CPU Core 1) Control Unit, Data Path 2) Single Cycle, Multi Cycle 2. AMBA Simple Bus(AHB Lite) 1) BUS Interconnector 3. Peripherals 1) RAM & ROM 2) GPI 3) GPIO ..

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2024.06.13 22:58

[VerilogHDL] Project : FPGA Multi Function Clock PPT & PDF

Project : FPGA Multi Function Clock ⦁ 개요 : Digilent Basys3를 이용한 FPGA Multi Function Clock 설계 및 검증 ⦁ 기능 1. Clock ↔ Stopwatch 모드 변경 1) 스위치 조작 2) UART 조작 : "Clock" 혹은 "Stopwatch" 입력 2. Clock 모드 : FND 시간 표시 1) 스위치 & 버튼 조작 a) 스위치 : [시 : 분] 혹은 [초 : 밀리초] FND 출력 모드 선택 b) 버튼 : 시간을 설정 & 0으로 설정 2) UART 조작 a) "..

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2024.03.09 00:23

[GDB Online] 온라인 코드 Debugging

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2024.03.05 22:50

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2024.02.26 19:04

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