[FullCustomIC] Cadence Virtuoso_4NAND, 4NOR, 2x1 MUX(Logic)Full Custom IC/Study2024. 3. 23. 22:55
Table of Contents
1. 4NAND Gate
⦁ 4NAND Truth Table
VINA | VINB | VINC | VIND | VOUT |
0 | 0 | 0 | 0 | 1 |
0 | 0 | 0 | 1 | 1 |
0 | 0 | 1 | 0 | 1 |
0 | 0 | 1 | 1 | 1 |
0 | 1 | 0 | 0 | 1 |
0 | 1 | 0 | 1 | 1 |
0 | 1 | 1 | 0 | 1 |
0 | 1 | 1 | 1 | 1 |
1 | 0 | 0 | 0 | 1 |
1 | 0 | 0 | 1 | 1 |
1 | 0 | 1 | 0 | 1 |
1 | 0 | 1 | 1 | 1 |
1 | 1 | 0 | 0 | 1 |
1 | 1 | 0 | 1 | 1 |
1 | 1 | 1 | 0 | 1 |
1 | 1 | 1 | 1 | 0 |
- pMOS w = 2.14u, nMOS w = 1u
- pMOS Finger Width : 2.14u, Total Width : 8.56u
- nMOS Finger Width : 1u, Total Width : 4u
2. 4NOR Gate
⦁ 4NOR Truth Table
VINA | VINB | VINC | VIND | VOUT |
0 | 0 | 0 | 0 | 1 |
0 | 0 | 0 | 1 | 0 |
0 | 0 | 1 | 0 | 0 |
0 | 0 | 1 | 1 | 0 |
0 | 1 | 0 | 0 | 0 |
0 | 1 | 0 | 1 | 0 |
0 | 1 | 1 | 0 | 0 |
0 | 1 | 1 | 1 | 0 |
1 | 0 | 0 | 0 | 0 |
1 | 0 | 0 | 1 | 0 |
1 | 0 | 1 | 0 | 0 |
1 | 0 | 1 | 1 | 0 |
1 | 1 | 0 | 0 | 0 |
1 | 1 | 0 | 1 | 0 |
1 | 1 | 1 | 0 | 0 |
1 | 1 | 1 | 1 | 0 |
- pMOS w = 5.96u, nMOS w = 1u
- pMOS Finger Width : 5.96u, Total Width : 23.84u
- nMOS Finger Width : 1u, Total Width : 4u
NAND, NOR 비교
2NAND | 3NAND | 4NAND | 2NOR | 3NOR | 4NOR | |
pMOS channel Width | 2.53u | 2.31u | 2.14u | 3.99u | 5u | 5.96u |
→ NAND 는 channel Width가 점점 줄어들지만 NOR는 channel Width가 점점 늘어난다
⇒ NAND 사용하는 것이 NOR보다 유리(면적 감소)
Logic Gates
: Logic Gate들을 하나의 Layout으로 설계
3. 2x1 MUX(Logic)
⦁ 2x1 MUX Truth Table
VINA | VINB | S0 | VOUT |
A | B | 0 | A |
A | B | 1 | B |
⦁ test set
VDD | VSS | VINA | VINB | S0 | |
source type | DC 1V | DC 0V | DC 1V | Pulse | Pulse |
Voltage range | x | x | x | 0 ~ 1V | 0 ~ 1V |
Period | x | x | x | 10ns | 100ns |
Delay time | x | x | x | 0s | 0s |
Rise time | x | x | x | 1ps | 1ps |
Fall time | x | x | x | 1ps | 1ps |
Pulse width | x | x | x | 5ns | 50ns |
Simulation time | 500ns |
→ Simulation 결과가 Truth table과 같은 것을 확인할 수 있다.
2x1 MUX(Logic) Layout
→ 2NAND pMOS Layout은 Source-Drain-Source 순이기 때문에 공통 단자인 Source를 합쳐 크기를 줄인다.
(nMOS는 공통 단자가 없어 불가능)
Made By Minseok KIM
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